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https://github.com/armbian/linux-rockchip.git
synced 2026-01-06 11:08:10 -08:00
change armsom-w3 screen and camera loading method to overlay (#285)
* add overlay:armsom-w3-camera-ov13850-csi * fix : armsom-w3 screen and camera loading method * add armsom-w3 overlay/Makefile * fix: add armsom-w3 overlay/makefile --------- Co-authored-by: jack@armsom.org <yidiantongxin>
This commit is contained in:
jackson
Mecid Urganci
@@ -7,6 +7,9 @@ dtbo-$(CONFIG_ARCH_ROCKCHIP) += \
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armsom-sige7-camera-ov13850-csi0.dtbo \
|
||||
armsom-sige7-camera-ov13850-csi1.dtbo \
|
||||
armsom-sige7-display-10hd.dtbo \
|
||||
armsom-w3-camera-imx419-csi.dtbo \
|
||||
armsom-w3-camera-ov13850-csi.dtbo \
|
||||
armsom-w3-display-10hd.dtbo \
|
||||
orangepi-5-lcd1.dtbo \
|
||||
orangepi-5-lcd2.dtbo \
|
||||
orangepi-5-sata.dtbo \
|
||||
|
||||
@@ -0,0 +1,236 @@
|
||||
/dts-v1/;
|
||||
/plugin/;
|
||||
|
||||
#include <dt-bindings/clock/rk3588-cru.h>
|
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#include <dt-bindings/power/rk3588-power.h>
|
||||
#include <dt-bindings/gpio/gpio.h>
|
||||
#include <dt-bindings/pinctrl/rockchip.h>
|
||||
|
||||
/ {
|
||||
compatible = "rockchip,rk3588";
|
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|
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fragment@0 {
|
||||
target = <&camera_pwdn_gpio>;
|
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__overlay__ {
|
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status = "okay";
|
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compatible = "regulator-fixed";
|
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regulator-name = "camera_pwdn_gpio";
|
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regulator-always-on;
|
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regulator-boot-on;
|
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enable-active-high;
|
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gpio = <&gpio1 RK_PB0 GPIO_ACTIVE_HIGH>;
|
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pinctrl-names = "default";
|
||||
pinctrl-0 = <&cam_pwdn_gpio>;
|
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};
|
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};
|
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|
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fragment@1 {
|
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target = <&clk_cam_24m>;
|
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__overlay__ {
|
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status = "okay";
|
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compatible = "fixed-clock";
|
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clock-frequency = <24000000>;
|
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clock-output-names = "clk_cam_24m";
|
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#clock-cells = <0>;
|
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};
|
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};
|
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|
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fragment@2 {
|
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target = <&i2c3>;
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
|
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imx415: imx415@1a {
|
||||
status = "okay";
|
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compatible = "sony,imx415";
|
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reg = <0x1a>;
|
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clocks = <&cru CLK_MIPI_CAMARAOUT_M3>;
|
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|
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pinctrl-names = "default";
|
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pinctrl-0 = <&mipim0_camera3_clk>;
|
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power-domains = <&power RK3588_PD_VI>;
|
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pwdn-gpios = <&gpio1 RK_PB0 GPIO_ACTIVE_HIGH>;
|
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reset-gpios = <&gpio4 RK_PA0 GPIO_ACTIVE_LOW>;
|
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rockchip,camera-module-index = <0>;
|
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|
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rockchip,camera-module-name = "CMK-OT2022-PX1";
|
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rockchip,camera-module-lens-name = "IR0147-50IRC-8M-F20";
|
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port {
|
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imx415_out0: endpoint {
|
||||
remote-endpoint = <&mipidphy0_in_ucam0>;
|
||||
data-lanes = <1 2 3 4>;
|
||||
};
|
||||
};
|
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};
|
||||
|
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camera_imx219: camera-imx219@10 {
|
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status = "disabled";
|
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compatible = "sony,imx219";
|
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reg = <0x10>;
|
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clocks = <&clk_cam_24m>;
|
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clock-names = "xvclk";
|
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rockchip,camera-module-index = <0>;
|
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rockchip,camera-module-facing = "back";
|
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rockchip,camera-module-name = "rpi-camera-v2";
|
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rockchip,camera-module-lens-name = "default";
|
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port {
|
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imx219_out0: endpoint {
|
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remote-endpoint = <&mipidphy0_in_ucam1>;
|
||||
data-lanes = <1 2>;
|
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};
|
||||
};
|
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};
|
||||
};
|
||||
};
|
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|
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fragment@3 {
|
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target = <&csi2_dphy0_hw>;
|
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__overlay__ {
|
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status = "okay";
|
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};
|
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};
|
||||
|
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fragment@4 {
|
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target = <&csi2_dphy0>;
|
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__overlay__ {
|
||||
status = "okay";
|
||||
|
||||
ports {
|
||||
#address-cells = <1>;
|
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#size-cells = <0>;
|
||||
|
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port@0 {
|
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reg = <0>;
|
||||
#address-cells = <1>;
|
||||
#size-cells = <0>;
|
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|
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mipidphy0_in_ucam0: endpoint@1 {
|
||||
reg = <1>;
|
||||
remote-endpoint = <&imx415_out0>;
|
||||
data-lanes = <1 2 3 4>;
|
||||
};
|
||||
|
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mipidphy0_in_ucam1: endpoint@2 {
|
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reg = <2>;
|
||||
remote-endpoint = <&imx219_out0>;
|
||||
data-lanes = <1 2>;
|
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};
|
||||
};
|
||||
|
||||
port@1 {
|
||||
reg = <1>;
|
||||
#address-cells = <1>;
|
||||
#size-cells = <0>;
|
||||
|
||||
csidphy0_out: endpoint@0 {
|
||||
reg = <0>;
|
||||
remote-endpoint = <&mipi2_csi2_input>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
fragment@5 {
|
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target = <&mipi2_csi2>;
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
|
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ports {
|
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#address-cells = <1>;
|
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#size-cells = <0>;
|
||||
|
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port@0 {
|
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reg = <0>;
|
||||
#address-cells = <1>;
|
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#size-cells = <0>;
|
||||
|
||||
mipi2_csi2_input: endpoint@1 {
|
||||
reg = <1>;
|
||||
remote-endpoint = <&csidphy0_out>;
|
||||
};
|
||||
};
|
||||
|
||||
port@1 {
|
||||
reg = <1>;
|
||||
#address-cells = <1>;
|
||||
#size-cells = <0>;
|
||||
|
||||
mipi2_csi2_output: endpoint@0 {
|
||||
reg = <0>;
|
||||
remote-endpoint = <&cif_mipi2_in0>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
fragment@6 {
|
||||
target = <&rkcif>;
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
};
|
||||
};
|
||||
|
||||
fragment@7 {
|
||||
target = <&rkcif_mipi_lvds2>;
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
|
||||
port {
|
||||
cif_mipi2_in0: endpoint {
|
||||
remote-endpoint = <&mipi2_csi2_output>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
fragment@8 {
|
||||
target = <&rkcif_mmu>;
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
};
|
||||
};
|
||||
|
||||
fragment@9 {
|
||||
target = <&rkisp0>;
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
};
|
||||
};
|
||||
|
||||
fragment@10 {
|
||||
target = <&isp0_mmu>;
|
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__overlay__ {
|
||||
status = "okay";
|
||||
};
|
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};
|
||||
|
||||
fragment@11 {
|
||||
target = <&rkisp0_vir0>;
|
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__overlay__ {
|
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status = "okay";
|
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|
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port {
|
||||
#address-cells = <1>;
|
||||
#size-cells = <0>;
|
||||
|
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isp0_vir0: endpoint@0 {
|
||||
reg = <0>;
|
||||
remote-endpoint = <&mipi_lvds2_sditf>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
|
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fragment@12 {
|
||||
target = <&pinctrl>;
|
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__overlay__ {
|
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camera {
|
||||
cam_pwdn_gpio: cam-pwdn-gpio {
|
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rockchip,pins = <1 RK_PB0 RK_FUNC_GPIO &pcfg_pull_up>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
203
arch/arm64/boot/dts/rockchip/overlay/armsom-w3-camera-ov13850-csi.dts
Executable file
203
arch/arm64/boot/dts/rockchip/overlay/armsom-w3-camera-ov13850-csi.dts
Executable file
@@ -0,0 +1,203 @@
|
||||
/dts-v1/;
|
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/plugin/;
|
||||
|
||||
#include <dt-bindings/clock/rk3588-cru.h>
|
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#include <dt-bindings/power/rk3588-power.h>
|
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#include <dt-bindings/gpio/gpio.h>
|
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#include <dt-bindings/pinctrl/rockchip.h>
|
||||
|
||||
/ {
|
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fragment@0 {
|
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target = <&i2c3>;
|
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|
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__overlay__ {
|
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status = "okay";
|
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#address-cells = <1>;
|
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#size-cells = <0>;
|
||||
|
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ov13850: ov13850@10{
|
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status = "okay";
|
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compatible = "ovti,ov13850";
|
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reg = <0x10>;
|
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clocks = <&cru CLK_MIPI_CAMARAOUT_M3>;
|
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clock-names = "xvclk";
|
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pinctrl-names = "default";
|
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pinctrl-0 = <&mipim0_camera3_clk>;
|
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power-domains = <&power RK3588_PD_VI>;
|
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rockchip,grf = <&sys_grf>;
|
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reset-gpios = <&gpio4 RK_PA0 GPIO_ACTIVE_HIGH>;
|
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rockchip,camera-module-index = <0>;
|
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rockchip,camera-module-facing = "back";
|
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rockchip,camera-module-name = "ZC-OV13850R2A-V1";
|
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rockchip,camera-module-lens-name = "Largan-50064B31";
|
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port {
|
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ov13850_out0: endpoint {
|
||||
remote-endpoint = <&mipidphy0_in_ucam0>;
|
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data-lanes = <1 2 3 4>;
|
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};
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
fragment@1 {
|
||||
target = <&csi2_dphy0_hw>;
|
||||
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
};
|
||||
};
|
||||
|
||||
fragment@2 {
|
||||
target = <&csi2_dphy0>;
|
||||
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
|
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ports {
|
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#address-cells = <1>;
|
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#size-cells = <0>;
|
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|
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port@0 {
|
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reg = <0>;
|
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#address-cells = <1>;
|
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#size-cells = <0>;
|
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|
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mipidphy0_in_ucam0: endpoint@1 {
|
||||
reg = <1>;
|
||||
remote-endpoint = <&ov13850_out0>;
|
||||
data-lanes = <1 2 3 4>;
|
||||
};
|
||||
|
||||
};
|
||||
|
||||
port@1 {
|
||||
reg = <1>;
|
||||
#address-cells = <1>;
|
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#size-cells = <0>;
|
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|
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csidphy0_out: endpoint@0 {
|
||||
reg = <0>;
|
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remote-endpoint = <&mipi2_csi2_input>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
|
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fragment@3 {
|
||||
target = <&mipi2_csi2>;
|
||||
|
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__overlay__ {
|
||||
status = "okay";
|
||||
|
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ports {
|
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#address-cells = <1>;
|
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#size-cells = <0>;
|
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|
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port@0 {
|
||||
reg = <0>;
|
||||
#address-cells = <1>;
|
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#size-cells = <0>;
|
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|
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mipi2_csi2_input: endpoint@1 {
|
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reg = <1>;
|
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remote-endpoint = <&csidphy0_out>;
|
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};
|
||||
};
|
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|
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port@1 {
|
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reg = <1>;
|
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#address-cells = <1>;
|
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#size-cells = <0>;
|
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|
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mipi2_csi2_output: endpoint@0 {
|
||||
reg = <0>;
|
||||
remote-endpoint = <&cif_mipi2_in0>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
fragment@4 {
|
||||
target = <&rkcif>;
|
||||
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
};
|
||||
};
|
||||
|
||||
fragment@5 {
|
||||
target = <&rkcif_mipi_lvds2>;
|
||||
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
|
||||
port {
|
||||
cif_mipi2_in0: endpoint {
|
||||
remote-endpoint = <&mipi2_csi2_output>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
fragment@6 {
|
||||
target = <&rkcif_mipi_lvds2_sditf>;
|
||||
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
|
||||
port {
|
||||
mipi_lvds2_sditf: endpoint {
|
||||
remote-endpoint = <&isp0_vir2>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
|
||||
fragment@7 {
|
||||
target = <&rkcif_mmu>;
|
||||
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
};
|
||||
};
|
||||
|
||||
fragment@8 {
|
||||
target = <&isp0_mmu>;
|
||||
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
};
|
||||
};
|
||||
|
||||
fragment@9 {
|
||||
target = <&rkisp0>;
|
||||
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
};
|
||||
};
|
||||
|
||||
fragment@10 {
|
||||
target = <&rkisp0_vir2>;
|
||||
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
|
||||
port {
|
||||
#address-cells = <1>;
|
||||
#size-cells = <0>;
|
||||
|
||||
isp0_vir2: endpoint@0 {
|
||||
reg = <0>;
|
||||
remote-endpoint = <&mipi_lvds2_sditf>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
};
|
||||
350
arch/arm64/boot/dts/rockchip/overlay/armsom-w3-display-10hd.dts
Normal file
350
arch/arm64/boot/dts/rockchip/overlay/armsom-w3-display-10hd.dts
Normal file
@@ -0,0 +1,350 @@
|
||||
/dts-v1/;
|
||||
/plugin/;
|
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|
||||
#include <dt-bindings/interrupt-controller/irq.h>
|
||||
#include <dt-bindings/gpio/gpio.h>
|
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#include <dt-bindings/pinctrl/rockchip.h>
|
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#include <dt-bindings/display/drm_mipi_dsi.h>
|
||||
|
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/ {
|
||||
fragment@0 {
|
||||
target-path = "/";
|
||||
|
||||
__overlay__ {
|
||||
vcc_lcd_mipi1: vcc-lcd-mipi1 {
|
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status = "okay";
|
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compatible = "regulator-fixed";
|
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|
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gpio = <&gpio1 RK_PC4 GPIO_ACTIVE_HIGH>;
|
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|
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|
||||
regulator-state-mem {
|
||||
regulator-off-in-suspend;
|
||||
};
|
||||
};
|
||||
|
||||
vcc5v0_lcd_n: vcc5v0-lcd0-n {
|
||||
status = "okay";
|
||||
compatible = "regulator-fixed";
|
||||
regulator-name = "vcc5v0_lcd_n";
|
||||
gpio = <&gpio2 RK_PC2 GPIO_ACTIVE_HIGH>;
|
||||
enable-active-high;
|
||||
regulator-boot-on;
|
||||
regulator-always-on;
|
||||
regulator-state-mem {
|
||||
regulator-off-in-suspend;
|
||||
};
|
||||
};
|
||||
|
||||
dsi1_backlight: dsi1-backlight {
|
||||
status = "okay";
|
||||
compatible = "pwm-backlight";
|
||||
pwms = <&pwm2 0 25000 0>;
|
||||
brightness-levels = <
|
||||
0 20 20 21 21 22 22 23
|
||||
23 24 24 25 25 26 26 27
|
||||
27 28 28 29 29 30 30 31
|
||||
31 32 32 33 33 34 34 35
|
||||
35 36 36 37 37 38 38 39
|
||||
40 41 42 43 44 45 46 47
|
||||
48 49 50 51 52 53 54 55
|
||||
56 57 58 59 60 61 62 63
|
||||
64 65 66 67 68 69 70 71
|
||||
72 73 74 75 76 77 78 79
|
||||
80 81 82 83 84 85 86 87
|
||||
88 89 90 91 92 93 94 95
|
||||
96 97 98 99 100 101 102 103
|
||||
104 105 106 107 108 109 110 111
|
||||
112 113 114 115 116 117 118 119
|
||||
120 121 122 123 124 125 126 127
|
||||
128 129 130 131 132 133 134 135
|
||||
136 137 138 139 140 141 142 143
|
||||
144 145 146 147 148 149 150 151
|
||||
152 153 154 155 156 157 158 159
|
||||
160 161 162 163 164 165 166 167
|
||||
168 169 170 171 172 173 174 175
|
||||
176 177 178 179 180 181 182 183
|
||||
184 185 186 187 188 189 190 191
|
||||
192 193 194 195 196 197 198 199
|
||||
200 201 202 203 204 205 206 207
|
||||
208 209 210 211 212 213 214 215
|
||||
216 217 218 219 220 221 222 223
|
||||
224 225 226 227 228 229 230 231
|
||||
232 233 234 235 236 237 238 239
|
||||
240 241 242 243 244 245 246 247
|
||||
248 249 250 251 252 253 254 255
|
||||
>;
|
||||
default-brightness-level = <200>;
|
||||
enable-gpios = <&gpio3 RK_PA1 GPIO_ACTIVE_HIGH>;
|
||||
pinctrl-names = "default";
|
||||
pinctrl-0 = <&dsi1_backlight_en>;
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
fragment@1 {
|
||||
target = <&pwm2>;
|
||||
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
pinctrl-names = "active";
|
||||
pinctrl-0 = <&pwm2m2_pins>;
|
||||
};
|
||||
};
|
||||
|
||||
fragment@2 {
|
||||
target = <&dsi1>;
|
||||
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
dsi1_panel: panel@0 {
|
||||
status = "okay";
|
||||
compatible = "simple-panel-dsi";
|
||||
reg = <0>;
|
||||
power-supply = <&vcc_lcd_mipi1>;
|
||||
reset-gpios = <&gpio2 RK_PC1 GPIO_ACTIVE_LOW>;
|
||||
backlight = <&dsi1_backlight>;
|
||||
pinctrl-names = "default";
|
||||
pinctrl-0 = <&dsi1_lcd_rst_gpio>;
|
||||
reset-delay-ms = <10>;
|
||||
enable-delay-ms = <10>;
|
||||
prepare-delay-ms = <10>;
|
||||
unprepare-delay-ms = <10>;
|
||||
disable-delay-ms = <10>;
|
||||
dsi,flags = <(MIPI_DSI_MODE_VIDEO | MIPI_DSI_MODE_VIDEO_BURST |
|
||||
MIPI_DSI_MODE_LPM | MIPI_DSI_MODE_EOT_PACKET)>;
|
||||
dsi,format = <MIPI_DSI_FMT_RGB888>;
|
||||
dsi,lanes = <4>;
|
||||
panel-init-sequence = [
|
||||
15 00 02 B0 01
|
||||
15 00 02 C0 26
|
||||
15 00 02 C1 10
|
||||
15 00 02 C2 0E
|
||||
15 00 02 C3 00
|
||||
15 00 02 C4 00
|
||||
15 00 02 C5 23
|
||||
15 00 02 C6 11
|
||||
15 00 02 C7 22
|
||||
15 00 02 C8 20
|
||||
15 00 02 C9 1E
|
||||
15 00 02 CA 1C
|
||||
15 00 02 CB 0C
|
||||
15 00 02 CC 0A
|
||||
15 00 02 CD 08
|
||||
15 00 02 CE 06
|
||||
15 00 02 CF 18
|
||||
15 00 02 D0 02
|
||||
15 00 02 D1 00
|
||||
15 00 02 D2 00
|
||||
15 00 02 D3 00
|
||||
15 00 02 D4 26
|
||||
15 00 02 D5 0F
|
||||
15 00 02 D6 0D
|
||||
15 00 02 D7 00
|
||||
15 00 02 D8 00
|
||||
15 00 02 D9 23
|
||||
15 00 02 DA 11
|
||||
15 00 02 DB 21
|
||||
15 00 02 DC 1F
|
||||
15 00 02 DD 1D
|
||||
15 00 02 DE 1B
|
||||
15 00 02 DF 0B
|
||||
15 00 02 E0 09
|
||||
15 00 02 E1 07
|
||||
15 00 02 E2 05
|
||||
15 00 02 E3 17
|
||||
15 00 02 E4 01
|
||||
15 00 02 E5 00
|
||||
15 00 02 E6 00
|
||||
15 00 02 E7 00
|
||||
15 00 02 B0 03
|
||||
15 00 02 BE 04
|
||||
15 00 02 B9 40
|
||||
15 00 02 CC 88
|
||||
15 00 02 C8 0C
|
||||
15 00 02 C9 07
|
||||
15 00 02 CD 01
|
||||
15 00 02 CA 40
|
||||
15 00 02 CE 1A
|
||||
15 00 02 CF 60
|
||||
15 00 02 D2 08
|
||||
15 00 02 D3 08
|
||||
15 00 02 DB 01
|
||||
15 00 02 D9 06
|
||||
15 00 02 D4 00
|
||||
15 00 02 D5 01
|
||||
15 00 02 D6 04
|
||||
15 00 02 D7 03
|
||||
15 00 02 C2 00
|
||||
15 00 02 C3 0E
|
||||
15 00 02 C4 00
|
||||
15 00 02 C5 0E
|
||||
15 00 02 DD 00
|
||||
15 00 02 DE 0E
|
||||
15 00 02 E6 00
|
||||
15 00 02 E7 0E
|
||||
15 00 02 C2 00
|
||||
15 00 02 C3 0E
|
||||
15 00 02 C4 00
|
||||
15 00 02 C5 0E
|
||||
15 00 02 DD 00
|
||||
15 00 02 DE 0E
|
||||
15 00 02 E6 00
|
||||
15 00 02 E7 0E
|
||||
15 00 02 B0 06
|
||||
15 00 02 C0 A5
|
||||
15 00 02 D5 1C
|
||||
15 00 02 C0 00
|
||||
15 00 02 B0 00
|
||||
15 00 02 BD 30
|
||||
|
||||
15 00 02 F9 5C
|
||||
15 00 02 C2 14
|
||||
15 00 02 C4 14
|
||||
15 00 02 BF 15
|
||||
15 00 02 C0 0C
|
||||
|
||||
|
||||
15 00 02 B0 00
|
||||
15 00 02 B1 79
|
||||
15 00 02 BA 8F
|
||||
|
||||
05 78 01 11
|
||||
05 78 01 29
|
||||
];
|
||||
|
||||
panel-exit-sequence = [
|
||||
05 32 01 28
|
||||
05 78 01 10
|
||||
];
|
||||
|
||||
disp_timings1: display-timings {
|
||||
native-mode = <&dsi1_timing0>;
|
||||
dsi1_timing0: timing0 {
|
||||
clock-frequency = <160000000>;
|
||||
hactive = <1200>;
|
||||
vactive = <1920>;
|
||||
hfront-porch = <80>;
|
||||
hsync-len = <1>;
|
||||
hback-porch = <60>;
|
||||
vfront-porch = <35>;
|
||||
vsync-len = <1>;
|
||||
vback-porch = <25>;
|
||||
hsync-active = <0>;
|
||||
vsync-active = <0>;
|
||||
de-active = <0>;
|
||||
pixelclk-active = <1>;
|
||||
};
|
||||
};
|
||||
ports {
|
||||
#address-cells = <1>;
|
||||
#size-cells = <0>;
|
||||
|
||||
port@0 {
|
||||
reg = <0>;
|
||||
panel_in_dsi1: endpoint {
|
||||
remote-endpoint = <&dsi1_out_panel>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
ports {
|
||||
#address-cells = <1>;
|
||||
#size-cells = <0>;
|
||||
|
||||
port@1 {
|
||||
reg = <1>;
|
||||
dsi1_out_panel: endpoint {
|
||||
remote-endpoint = <&panel_in_dsi1>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
fragment@3 {
|
||||
target = <&mipi_dcphy1>;
|
||||
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
};
|
||||
};
|
||||
|
||||
|
||||
fragment@4 {
|
||||
target = <&route_dsi1>;
|
||||
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
connect = <&vp3_out_dsi1>;
|
||||
};
|
||||
};
|
||||
|
||||
fragment@5 {
|
||||
target = <&dsi1_in_vp2>;
|
||||
|
||||
__overlay__ {
|
||||
status = "disabled";
|
||||
};
|
||||
};
|
||||
|
||||
fragment@6 {
|
||||
target = <&dsi1_in_vp3>;
|
||||
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
|
||||
};
|
||||
};
|
||||
|
||||
fragment@7 {
|
||||
target = <&i2c6>;
|
||||
|
||||
__overlay__ {
|
||||
status = "okay";
|
||||
|
||||
gt9xx: gt9xx@14 {
|
||||
status = "okay";
|
||||
compatible = "goodix,gt9xx";
|
||||
reg = <0x14>;
|
||||
pinctrl-names = "default";
|
||||
pinctrl-0 = <>9xx_gpio>;
|
||||
touch-gpio = <&gpio0 RK_PD3 IRQ_TYPE_LEVEL_HIGH>;
|
||||
reset-gpio = <&gpio0 RK_PC6 GPIO_ACTIVE_HIGH>;
|
||||
max-x = <1200>;
|
||||
max-y = <1920>;
|
||||
tp-size = <89>;
|
||||
tp-supply = <&vcc_lcd_mipi1>;
|
||||
|
||||
configfile-num = <1>;
|
||||
};
|
||||
|
||||
};
|
||||
};
|
||||
|
||||
fragment@8 {
|
||||
target = <&pinctrl>;
|
||||
|
||||
__overlay__ {
|
||||
dsi1-lcd {
|
||||
dsi1_lcd_rst_gpio: dsi1-lcd-rst-gpio {
|
||||
rockchip,pins =
|
||||
<2 RK_PC1 RK_FUNC_GPIO &pcfg_pull_up>;
|
||||
};
|
||||
|
||||
dsi1_backlight_en: dsi1-backlight-en {
|
||||
rockchip,pins =
|
||||
<3 RK_PA1 RK_FUNC_GPIO &pcfg_pull_up>;
|
||||
};
|
||||
};
|
||||
|
||||
gt9xx {
|
||||
gt9xx_gpio: gt9xx-gpio {
|
||||
rockchip,pins =
|
||||
<0 RK_PC6 RK_FUNC_GPIO &pcfg_pull_none>,
|
||||
<0 RK_PD3 RK_FUNC_GPIO &pcfg_pull_up>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
@@ -1,206 +0,0 @@
|
||||
// SPDX-License-Identifier: (GPL-2.0+ OR MIT)
|
||||
/*
|
||||
* Copyright (c) 2022 Rockchip Electronics Co., Ltd.
|
||||
*
|
||||
*/
|
||||
|
||||
/ {
|
||||
camera_pwdn_gpio: camera-pwdn-gpio {
|
||||
status = "okay";
|
||||
compatible = "regulator-fixed";
|
||||
regulator-name = "camera_pwdn_gpio";
|
||||
regulator-always-on;
|
||||
regulator-boot-on;
|
||||
enable-active-high;
|
||||
gpio = <&gpio1 RK_PB0 GPIO_ACTIVE_HIGH>;
|
||||
pinctrl-names = "default";
|
||||
pinctrl-0 = <&cam_pwdn_gpio>;
|
||||
};
|
||||
|
||||
clk_cam_24m: external-camera-clock-24m {
|
||||
status = "okay";
|
||||
compatible = "fixed-clock";
|
||||
clock-frequency = <24000000>;
|
||||
clock-output-names = "clk_cam_24m";
|
||||
#clock-cells = <0>;
|
||||
};
|
||||
};
|
||||
|
||||
&i2c3 {
|
||||
status = "okay";
|
||||
|
||||
imx415: imx415@1a {
|
||||
status = "okay";
|
||||
compatible = "sony,imx415";
|
||||
reg = <0x1a>;
|
||||
clocks = <&cru CLK_MIPI_CAMARAOUT_M3>;
|
||||
clock-names = "xvclk";
|
||||
pinctrl-names = "default";
|
||||
pinctrl-0 = <&mipim0_camera3_clk>;
|
||||
power-domains = <&power RK3588_PD_VI>;
|
||||
pwdn-gpios = <&gpio1 RK_PB0 GPIO_ACTIVE_HIGH>;
|
||||
reset-gpios = <&gpio4 RK_PA0 GPIO_ACTIVE_LOW>;
|
||||
rockchip,camera-module-index = <0>;
|
||||
rockchip,camera-module-facing = "back";
|
||||
rockchip,camera-module-name = "CMK-OT2022-PX1";
|
||||
rockchip,camera-module-lens-name = "IR0147-50IRC-8M-F20";
|
||||
port {
|
||||
imx415_out0: endpoint {
|
||||
remote-endpoint = <&mipidphy0_in_ucam0>;
|
||||
data-lanes = <1 2 3 4>;
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
camera_imx219: camera-imx219@10 {
|
||||
status = "disabled";
|
||||
compatible = "sony,imx219";
|
||||
reg = <0x10>;
|
||||
|
||||
clocks = <&clk_cam_24m>;
|
||||
clock-names = "xvclk";
|
||||
|
||||
rockchip,camera-module-index = <0>;
|
||||
rockchip,camera-module-facing = "back";
|
||||
rockchip,camera-module-name = "rpi-camera-v2";
|
||||
rockchip,camera-module-lens-name = "default";
|
||||
|
||||
port {
|
||||
imx219_out0: endpoint {
|
||||
remote-endpoint = <&mipidphy0_in_ucam1>;
|
||||
data-lanes = <1 2>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
&csi2_dphy0_hw {
|
||||
status = "okay";
|
||||
};
|
||||
|
||||
&csi2_dphy0 {
|
||||
status = "okay";
|
||||
|
||||
ports {
|
||||
#address-cells = <1>;
|
||||
#size-cells = <0>;
|
||||
|
||||
port@0 {
|
||||
reg = <0>;
|
||||
#address-cells = <1>;
|
||||
#size-cells = <0>;
|
||||
|
||||
mipidphy0_in_ucam0: endpoint@1 {
|
||||
reg = <1>;
|
||||
remote-endpoint = <&imx415_out0>;
|
||||
data-lanes = <1 2 3 4>;
|
||||
};
|
||||
|
||||
mipidphy0_in_ucam1: endpoint@2 {
|
||||
reg = <2>;
|
||||
remote-endpoint = <&imx219_out0>;
|
||||
data-lanes = <1 2>;
|
||||
};
|
||||
};
|
||||
|
||||
port@1 {
|
||||
reg = <1>;
|
||||
#address-cells = <1>;
|
||||
#size-cells = <0>;
|
||||
|
||||
csidphy0_out: endpoint@0 {
|
||||
reg = <0>;
|
||||
remote-endpoint = <&mipi2_csi2_input>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
&mipi2_csi2 {
|
||||
status = "okay";
|
||||
|
||||
ports {
|
||||
#address-cells = <1>;
|
||||
#size-cells = <0>;
|
||||
|
||||
port@0 {
|
||||
reg = <0>;
|
||||
#address-cells = <1>;
|
||||
#size-cells = <0>;
|
||||
|
||||
mipi2_csi2_input: endpoint@1 {
|
||||
reg = <1>;
|
||||
remote-endpoint = <&csidphy0_out>;
|
||||
};
|
||||
};
|
||||
|
||||
port@1 {
|
||||
reg = <1>;
|
||||
#address-cells = <1>;
|
||||
#size-cells = <0>;
|
||||
|
||||
mipi2_csi2_output: endpoint@0 {
|
||||
reg = <0>;
|
||||
remote-endpoint = <&cif_mipi2_in0>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
&rkcif {
|
||||
status = "okay";
|
||||
};
|
||||
|
||||
&rkcif_mipi_lvds2 {
|
||||
status = "okay";
|
||||
|
||||
port {
|
||||
cif_mipi2_in0: endpoint {
|
||||
remote-endpoint = <&mipi2_csi2_output>;
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
&rkcif_mipi_lvds2_sditf {
|
||||
status = "okay";
|
||||
|
||||
port {
|
||||
mipi_lvds2_sditf: endpoint {
|
||||
remote-endpoint = <&isp0_vir0>;
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
&rkcif_mmu {
|
||||
status = "okay";
|
||||
};
|
||||
|
||||
&rkisp0 {
|
||||
status = "okay";
|
||||
};
|
||||
|
||||
&isp0_mmu {
|
||||
status = "okay";
|
||||
};
|
||||
|
||||
&rkisp0_vir0 {
|
||||
status = "okay";
|
||||
|
||||
port {
|
||||
#address-cells = <1>;
|
||||
#size-cells = <0>;
|
||||
|
||||
isp0_vir0: endpoint@0 {
|
||||
reg = <0>;
|
||||
remote-endpoint = <&mipi_lvds2_sditf>;
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
&pinctrl {
|
||||
camera {
|
||||
cam_pwdn_gpio: cam-pwdn-gpio {
|
||||
rockchip,pins = <1 RK_PB0 RK_FUNC_GPIO &pcfg_pull_up>;
|
||||
};
|
||||
};
|
||||
};
|
||||
@@ -1,307 +0,0 @@
|
||||
// SPDX-License-Identifier: (GPL-2.0+ OR MIT)
|
||||
/*
|
||||
* Copyright (c) 2022 bananapi Limited.
|
||||
*
|
||||
*/
|
||||
|
||||
/ {
|
||||
vcc_lcd_mipi1: vcc-lcd-mipi1 {
|
||||
status = "okay";
|
||||
compatible = "regulator-fixed";
|
||||
regulator-name = "vcc_lcd_mipi1";
|
||||
gpio = <&gpio1 RK_PC4 GPIO_ACTIVE_HIGH>;
|
||||
enable-active-high;
|
||||
regulator-boot-on;
|
||||
regulator-state-mem {
|
||||
regulator-off-in-suspend;
|
||||
};
|
||||
};
|
||||
|
||||
dsi1_backlight: dsi1-backlight {
|
||||
status = "okay";
|
||||
compatible = "pwm-backlight";
|
||||
pwms = <&pwm2 0 25000 0>;
|
||||
brightness-levels = <
|
||||
0 20 20 21 21 22 22 23
|
||||
23 24 24 25 25 26 26 27
|
||||
27 28 28 29 29 30 30 31
|
||||
31 32 32 33 33 34 34 35
|
||||
35 36 36 37 37 38 38 39
|
||||
40 41 42 43 44 45 46 47
|
||||
48 49 50 51 52 53 54 55
|
||||
56 57 58 59 60 61 62 63
|
||||
64 65 66 67 68 69 70 71
|
||||
72 73 74 75 76 77 78 79
|
||||
80 81 82 83 84 85 86 87
|
||||
88 89 90 91 92 93 94 95
|
||||
96 97 98 99 100 101 102 103
|
||||
104 105 106 107 108 109 110 111
|
||||
112 113 114 115 116 117 118 119
|
||||
120 121 122 123 124 125 126 127
|
||||
128 129 130 131 132 133 134 135
|
||||
136 137 138 139 140 141 142 143
|
||||
144 145 146 147 148 149 150 151
|
||||
152 153 154 155 156 157 158 159
|
||||
160 161 162 163 164 165 166 167
|
||||
168 169 170 171 172 173 174 175
|
||||
176 177 178 179 180 181 182 183
|
||||
184 185 186 187 188 189 190 191
|
||||
192 193 194 195 196 197 198 199
|
||||
200 201 202 203 204 205 206 207
|
||||
208 209 210 211 212 213 214 215
|
||||
216 217 218 219 220 221 222 223
|
||||
224 225 226 227 228 229 230 231
|
||||
232 233 234 235 236 237 238 239
|
||||
240 241 242 243 244 245 246 247
|
||||
248 249 250 251 252 253 254 255
|
||||
>;
|
||||
default-brightness-level = <200>;
|
||||
enable-gpios = <&gpio2 RK_PC2 GPIO_ACTIVE_HIGH>;
|
||||
pinctrl-names = "default";
|
||||
pinctrl-0 = <&dsi1_backlight_en>;
|
||||
};
|
||||
};
|
||||
|
||||
&pwm2 {
|
||||
status = "okay";
|
||||
pinctrl-names = "active";
|
||||
pinctrl-0 = <&pwm2m2_pins>;
|
||||
};
|
||||
|
||||
&dsi1 {
|
||||
status = "okay";
|
||||
dsi1_panel: panel@0 {
|
||||
status = "okay";
|
||||
compatible = "simple-panel-dsi";
|
||||
reg = <0>;
|
||||
power-supply = <&vcc_lcd_mipi1>;
|
||||
reset-gpios = <&gpio2 RK_PC1 GPIO_ACTIVE_LOW>;
|
||||
backlight = <&dsi1_backlight>;
|
||||
pinctrl-names = "default";
|
||||
pinctrl-0 = <&dsi1_lcd_rst_gpio>;
|
||||
reset-delay-ms = <10>;
|
||||
enable-delay-ms = <10>;
|
||||
prepare-delay-ms = <10>;
|
||||
unprepare-delay-ms = <10>;
|
||||
disable-delay-ms = <10>;
|
||||
dsi,flags = <(MIPI_DSI_MODE_VIDEO | MIPI_DSI_MODE_VIDEO_BURST |
|
||||
MIPI_DSI_MODE_LPM | MIPI_DSI_MODE_EOT_PACKET)>;
|
||||
dsi,format = <MIPI_DSI_FMT_RGB888>;
|
||||
dsi,lanes = <4>;
|
||||
panel-init-sequence = [
|
||||
15 00 02 B0 01
|
||||
15 00 02 C0 26
|
||||
15 00 02 C1 10
|
||||
15 00 02 C2 0E
|
||||
15 00 02 C3 00
|
||||
15 00 02 C4 00
|
||||
15 00 02 C5 23
|
||||
15 00 02 C6 11
|
||||
15 00 02 C7 22
|
||||
15 00 02 C8 20
|
||||
15 00 02 C9 1E
|
||||
15 00 02 CA 1C
|
||||
15 00 02 CB 0C
|
||||
15 00 02 CC 0A
|
||||
15 00 02 CD 08
|
||||
15 00 02 CE 06
|
||||
15 00 02 CF 18
|
||||
15 00 02 D0 02
|
||||
15 00 02 D1 00
|
||||
15 00 02 D2 00
|
||||
15 00 02 D3 00
|
||||
15 00 02 D4 26
|
||||
15 00 02 D5 0F
|
||||
15 00 02 D6 0D
|
||||
15 00 02 D7 00
|
||||
15 00 02 D8 00
|
||||
15 00 02 D9 23
|
||||
15 00 02 DA 11
|
||||
15 00 02 DB 21
|
||||
15 00 02 DC 1F
|
||||
15 00 02 DD 1D
|
||||
15 00 02 DE 1B
|
||||
15 00 02 DF 0B
|
||||
15 00 02 E0 09
|
||||
15 00 02 E1 07
|
||||
15 00 02 E2 05
|
||||
15 00 02 E3 17
|
||||
15 00 02 E4 01
|
||||
15 00 02 E5 00
|
||||
15 00 02 E6 00
|
||||
15 00 02 E7 00
|
||||
15 00 02 B0 03
|
||||
15 00 02 BE 04
|
||||
15 00 02 B9 40
|
||||
15 00 02 CC 88
|
||||
15 00 02 C8 0C
|
||||
15 00 02 C9 07
|
||||
15 00 02 CD 01
|
||||
15 00 02 CA 40
|
||||
15 00 02 CE 1A
|
||||
15 00 02 CF 60
|
||||
15 00 02 D2 08
|
||||
15 00 02 D3 08
|
||||
15 00 02 DB 01
|
||||
15 00 02 D9 06
|
||||
15 00 02 D4 00
|
||||
15 00 02 D5 01
|
||||
15 00 02 D6 04
|
||||
15 00 02 D7 03
|
||||
15 00 02 C2 00
|
||||
15 00 02 C3 0E
|
||||
15 00 02 C4 00
|
||||
15 00 02 C5 0E
|
||||
15 00 02 DD 00
|
||||
15 00 02 DE 0E
|
||||
15 00 02 E6 00
|
||||
15 00 02 E7 0E
|
||||
15 00 02 C2 00
|
||||
15 00 02 C3 0E
|
||||
15 00 02 C4 00
|
||||
15 00 02 C5 0E
|
||||
15 00 02 DD 00
|
||||
15 00 02 DE 0E
|
||||
15 00 02 E6 00
|
||||
15 00 02 E7 0E
|
||||
15 00 02 B0 06
|
||||
15 00 02 C0 A5
|
||||
15 00 02 D5 1C
|
||||
15 00 02 C0 00
|
||||
15 00 02 B0 00
|
||||
15 00 02 BD 30
|
||||
|
||||
15 00 02 F9 5C
|
||||
15 00 02 C2 14
|
||||
15 00 02 C4 14
|
||||
15 00 02 BF 15
|
||||
15 00 02 C0 0C
|
||||
|
||||
|
||||
15 00 02 B0 00
|
||||
15 00 02 B1 79
|
||||
15 00 02 BA 8F
|
||||
|
||||
05 78 01 11
|
||||
05 78 01 29
|
||||
];
|
||||
|
||||
panel-exit-sequence = [
|
||||
05 32 01 28
|
||||
05 78 01 10
|
||||
];
|
||||
|
||||
disp_timings1: display-timings {
|
||||
native-mode = <&dsi1_timing0>;
|
||||
dsi1_timing0: timing0 {
|
||||
clock-frequency = <160000000>;
|
||||
hactive = <1200>;
|
||||
vactive = <1920>;
|
||||
hfront-porch = <80>;
|
||||
hsync-len = <1>;
|
||||
hback-porch = <60>;
|
||||
vfront-porch = <35>;
|
||||
vsync-len = <1>;
|
||||
vback-porch = <25>;
|
||||
hsync-active = <0>;
|
||||
vsync-active = <0>;
|
||||
de-active = <0>;
|
||||
pixelclk-active = <1>;
|
||||
};
|
||||
};
|
||||
ports {
|
||||
#address-cells = <1>;
|
||||
#size-cells = <0>;
|
||||
|
||||
port@0 {
|
||||
reg = <0>;
|
||||
panel_in_dsi1: endpoint {
|
||||
remote-endpoint = <&dsi1_out_panel>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
ports {
|
||||
#address-cells = <1>;
|
||||
#size-cells = <0>;
|
||||
|
||||
port@1 {
|
||||
reg = <1>;
|
||||
dsi1_out_panel: endpoint {
|
||||
remote-endpoint = <&panel_in_dsi1>;
|
||||
};
|
||||
};
|
||||
};
|
||||
};
|
||||
|
||||
|
||||
&mipi_dcphy1 {
|
||||
status = "okay";
|
||||
};
|
||||
|
||||
&route_dsi1 {
|
||||
status = "okay";
|
||||
connect = <&vp3_out_dsi1>;
|
||||
};
|
||||
|
||||
&dsi1_in_vp2 {
|
||||
status = "disabled";
|
||||
};
|
||||
|
||||
&dsi1_in_vp3 {
|
||||
status = "okay";
|
||||
};
|
||||
|
||||
&i2c6 {
|
||||
status = "okay";
|
||||
// pinctrl-names = "default";
|
||||
// pinctrl-0 = <&i2c6m0_xfer>;
|
||||
//clock-frequency = <400000>;
|
||||
|
||||
gt9xx: gt9xx@14 {
|
||||
status = "okay";
|
||||
compatible = "goodix,gt9xx";
|
||||
reg = <0x14>;
|
||||
pinctrl-names = "default";
|
||||
pinctrl-0 = <>9xx_gpio>;
|
||||
touch-gpio = <&gpio0 RK_PD3 IRQ_TYPE_LEVEL_HIGH>;
|
||||
reset-gpio = <&gpio0 RK_PC6 GPIO_ACTIVE_HIGH>;
|
||||
max-x = <1200>;
|
||||
max-y = <1920>;
|
||||
tp-size = <89>;
|
||||
tp-supply = <&vcc_lcd_mipi1>;
|
||||
|
||||
configfile-num = <1>;
|
||||
};
|
||||
};
|
||||
|
||||
&pinctrl {
|
||||
|
||||
dsi1-lcd {
|
||||
dsi1_lcd_rst_gpio: dsi1-lcd-rst-gpio {
|
||||
rockchip,pins =
|
||||
<2 RK_PC1 RK_FUNC_GPIO &pcfg_pull_up>;
|
||||
};
|
||||
|
||||
dsi1_backlight_en: dsi1-backlight-en {
|
||||
rockchip,pins =
|
||||
<2 RK_PC2 RK_FUNC_GPIO &pcfg_pull_up>;
|
||||
};
|
||||
};
|
||||
|
||||
gt9xx {
|
||||
gt9xx_gpio: gt9xx-gpio {
|
||||
rockchip,pins =
|
||||
<0 RK_PC6 RK_FUNC_GPIO &pcfg_pull_none>,
|
||||
<0 RK_PD3 RK_FUNC_GPIO &pcfg_pull_up>;
|
||||
};
|
||||
};
|
||||
|
||||
focaltech {
|
||||
focaltech_gpio: focaltech-gpio {
|
||||
rockchip,pins =
|
||||
<0 RK_PC6 RK_FUNC_GPIO &pcfg_pull_none>,
|
||||
<0 RK_PD3 RK_FUNC_GPIO &pcfg_pull_up>;
|
||||
};
|
||||
};
|
||||
};
|
||||
@@ -19,8 +19,6 @@
|
||||
#include "rk3588.dtsi"
|
||||
#include "rk3588-rk806-single.dtsi"
|
||||
#include "rk3588-linux.dtsi"
|
||||
// #include "rk3588-armsom-w3-display.dtsi"
|
||||
#include "rk3588-armsom-w3-camera.dtsi"
|
||||
|
||||
/ {
|
||||
model = "armsom w3";
|
||||
|
||||
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